平码五不中公式规律
  • / 17
  • 下载费用:30 金币  

一种数据读取方法、集成电路及芯片.pdf

关 键 ?#21097;?/dt>
一种 数据 读取 方法 集成电路 芯片
  专利查询网所有资源均是用户自行上传分享,仅供网友学习交流,未经上传用户书面授权,请勿作他用。
摘要
申请专利号:

CN201710154782.8

申请日:

2017.03.15

公开号:

CN106683703A

公开日:

2017.05.17

当前法律状态:

实审

有效性:

审中

法?#19978;?#24773;: 实质审查的生效IPC(主分类):G11C 16/26申请日:20170315|||公开
IPC分类号: G11C16/26; G11C16/34; G11C16/22 主分类号: G11C16/26
申请人: 珠海格力电器股份有限公司
发明人: 温浪明; 陈恒; 易冬柏; 方励
地址: 519070 广东省珠海市前山金鸡西路
优先权:
专利代理机构: ?#26412;?#38598;佳知识产权代理有限公司 11227 代理人: 王宝筠
PDF完整版下载: PDF下载
法律状态
申请(专利)号:

CN201710154782.8

授权公告号:

|||

法律状态公告日:

2017.06.09|||2017.05.17

法律状态类型:

实质审查的生效|||公开

摘要

本发明公开了一种数据读取方法、集成电路及芯片,集成电路包括:低电压检测逻辑电路和NVM控制器,在NVM控制器从NVM读取数据之前,低电压检测逻辑电路会首先从NVM的预烧区域读取预烧区域返回值,通过比较预烧区域返回值和预先烧写到预烧区域的目标预烧值是否相等,确定NVM的供电电压是否正常,并且只有在预烧区域返回值和目标预烧值相等时,即NVM的供电电压正常时,NVM控制器才会从NVM内读取数据。由此可知,本发明是在确定NVM的供电电压正常后,才读取NVM内的数据,因此,能够有效保证读取NVM的数据的稳定性,避免因NVM的供电电压处于非正常状态所带来的读取数据不稳定的问题。

权利要求书

1.一种数据读取方法,其特征在于,所述方法包括:
当接收到读取NVM内数据请求时,从所述NVM预先设置的预烧区域读取预烧区域返回
值,其中,所述预烧区域为所述NVM内对低供电电压敏感的存储空间,所述预烧区域返回值
为从所述预烧区域读取的值;
当所述预烧区域返回值等于目标预烧值时,生成第一控制信号,并将所述第一控制信
号输出至NVM控制器,控制所述NVM控制器从所述NVM内读取数据,其中,所述目标预烧值为
预先烧写到所述预烧区域的值。
2.根据权利要求1所述的数据读取方法,其特征在于,还包括:
当所述预烧区域返回值不等于所述目标预烧值时,生成第二控制信号,并将所述第二
控制信号输出至芯片保护部件,控制所述芯片保护部件触发芯片进入自?#20918;?#25252;模式。
3.根据权利要求1所述的数据读取方法,其特征在于,还包括:
当所述预烧区域返回值不等于所述目标预烧值时,生成第三控制信号,并将所述第三
控制信号输出?#20102;?#36848;NVM控制器,所述第三控制信号用于控制所述NVM控制器禁止读取所述
NVM内的数据。
4.根据权利要求2所述的数据读取方法,其特征在于,所述控制所述芯片保护部件触发
芯片进入自?#20918;?#25252;模式包括:
控制所述芯片保护部件触发?#20302;?#32423;芯片SoC复位;或,
在不触发所述SoC复位的情况下,控制所述芯片进入安全模式,以使外部仅能侦测到
NVM低电压的错误信息。
5.一种低电压检测逻辑电路,其特征在于,所述低电压检测逻辑电路分别与NVM、NVM控
制器以及芯片保护部件连接,所述低电压检测逻辑电路包括:
读取单元,用于当接收到读取所述NVM内数据请求时,从所述NVM预先设置的预烧区域
读取预烧区域返回值,其中,所述预烧区域为所述NVM内对低供电电压敏感的存储空间,所
述预烧区域返回值为从所述预烧区域读取的值;
第一控制单元,用于当所述预烧区域返回值等于目标预烧值时,生成第一控制信号,并
将所述第一控制信号输出至NVM控制器,控制所述NVM控制器从所述NVM内读取数据,其中,
所述目标预烧值为预先烧写到所述预烧区域的值。
6.根据权利要求5所述的低电压检测逻辑电路,其特征在于,还包括:
第二控制单元,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第二控制
信号,并将所述第二控制信号输出至芯片保护部件,控制所述芯片保护部件触发芯片进入
自?#20918;?#25252;模式。
7.根据权利要求5所述的低电压检测逻辑电路,其特征在于,还包括:
第三控制单元,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第三控制
信号,并将所述第三控制信号输出?#20102;?#36848;NVM控制器,所述第三控制信号用于控制所述NVM
控制器禁止读取所述NVM内的数据。
8.根据权利要求5所述的低电压检测逻辑电路,其特征在于,所述预烧区域为与NVM供
电电源的偏移量超过第一偏移量的存储空间。
9.根据权利要求5所述的低电压检测逻辑电路,其特征在于,所述预烧区域存储的目标
预烧值为与初始值相反的值。
10.根据权利要求5所述的低电压检测逻辑电路,其特征在于,所述预烧区域为1个或多
个。
11.一种集成电路,其特征在于,包括:NVM控制器、以及权利要求5-10?#25105;?#19968;项所述的
低电压检测逻辑电路;
所述NVM控制器的第一输入端与所述低电压检测逻辑电路的第一信号控制端连接,所
述NVM控制器的第二输入端与NVM连接,所述NVM控制器用于在所述低电压检测逻辑电路判
定从所述NVM预先设置的预烧区域读取的预烧区域返回值等于目标预烧值时,根据所述低
电压检测逻辑电路生成的第一控制信号,从所述NVM内读取数据;在所述低电压检测逻辑电
路判定所述预烧区域返回值不等于所述目标预烧值时,接收所述低电压检测逻辑电路生成
的第三控制信号,所述第三控制信号用于控制所述NVM控制器禁止读取所述NVM内的数据;
其中,所述目标预烧值为预先烧写到所述预烧区域的值,所述预烧区域为所述NVM内对
低供电电压敏感的存储空间。
12.根据权利要求11所述的集成电路,其特征在于,还包括:芯片保护部件;
所述芯片保护部件的输入端与所述低电压检测逻辑电路的第二信号控制端连接,所述
芯片保护部件用于在所述低电压检测逻辑电路判定所述预烧区域返回值不等于所述目标
预烧值时,根据所述低电压检测逻辑电路生成的第二控制信号,触发芯片进入自?#20918;?#25252;模
式。
13.一种芯片,其特征在于,包括:权利要求11或12?#25105;?#19968;项所述的集成电路。
14.一种芯片,其特征在于,包括:权利要求11或12?#25105;?#19968;项所述的集成电路,以及与所
述集成电路连接的NVM,其中,所述NVM预先设置有对低供电电压敏感的预烧区域,所述预烧
区域内预先烧?#20174;?#30446;标预烧值。

说明书

一种数据读取方法、集成电路及芯片

技术领域

本发明涉及集成电路技术领域,更具体的说,涉及一种数据读取方法、集成电路及
芯片。

背景技术

NVM(NonVolatile Memory,?#19988;资?#23384;储器)是一种具有?#19988;资А?#25353;?#32440;?#23384;取、存储
密度高、低能耗、读写性能接近DRAM(Dynamic Random Access Memory,动态随机存取存储
器)的存储器,广泛应用于SOC(System on Chip,)设计中,用于存储?#20302;?#37197;置信息、数据以
及可执?#20889;?#30721;,担当着?#20302;?#19981;可缺少的角色。

NVM作为存储逻辑单元,其供电电压的稳定性直接影响从NVM中读取数据的稳定
性,尤其是当NVM的供电电压低于其规格书所要求的最低阈值时,NVM可能会因为供电电压
不足导致读取的数据仍为初始值。例如,OTP(One-time Password,动态口令)单元的初始值
是0,成功烧写至NVM后变成1,但是当NVM工作在较低供电电压时,从NVM读取出的数据可能
就会变成0。

综上,如何提供一种集成电路保证读取NVM内数据的稳定性,抵御非正常供电电压
所带来的读取数据不稳定的问题是本领域技术人?#24517;?#38656;解决的技术问题。

发明内容

有鉴于此,本发明公开一种数据读取方法、集成电路及芯片,以实现对NVM内数据
读取的稳定性,避免因NVM处于非正常供电电压带来的读取数据不稳定的问题。

一种数据读取方法,所述方法包括:

当接收到读取NVM内数据请求时,从所述NVM预先设置的预烧区域读取预烧区域返
回值,其中,所述预烧区域为所述NVM内对低供电电压敏感的存储空间,所述预烧区域返回
值为从所述预烧区域读取的值;

当所述预烧区域返回值等于目标预烧值时,生成第一控制信号,并将所述第一控
制信号输出至NVM控制器,控制所述NVM控制器从所述NVM内读取数据,其中,所述目标预烧
值为预先烧写到所述预烧区域的值。

优选的,还包括:

当所述预烧区域返回值不等于所述目标预烧值时,生成第二控制信号,并将所述
第二控制信号输出至芯片保护部件,控制所述芯片保护部件触发芯片进入自?#20918;?#25252;模式。

优选的,还包括:

当所述预烧区域返回值不等于所述目标预烧值时,生成第三控制信号,并将所述
第三控制信号输出?#20102;?#36848;NVM控制器,所述第三控制信号用于控制所述NVM控制器禁止读取
所述NVM内的数据。

优选的,所述控制所述芯片保护部件触发芯片进入自?#20918;?#25252;模式包括:

控制所述芯片保护部件触发?#20302;?#32423;芯片SoC复位;或,

在不触发所述SoC复位的情况下,控制所述芯片进入安全模式,以使外部仅能侦测
到NVM低电压的错误信息。

一种低电压检测逻辑电路所述低电压检测逻辑电路分别与NVM、NVM控制器以及芯
片保护部件连接,所述低电压检测逻辑电路包括:

读取单元,用于当接收到读取所述NVM内数据请求时,从所述NVM预先设置的预烧
区域读取预烧区域返回值,其中,所述预烧区域为所述NVM内对低供电电压敏感的存储空
间,所述预烧区域返回值为从所述预烧区域读取的值;

第一控制单元,用于当所述预烧区域返回值等于目标预烧值时,生成第一控制信
号,并将所述第一控制信号输出至NVM控制器,控制所述NVM控制器从所述NVM内读取数据,
其中,所述目标预烧值为预先烧写到所述预烧区域的值。

优选的,还包括:

第二控制单元,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第二
控制信号,并将所述第二控制信号输出至芯片保护部件,控制所述芯片保护部件触发芯片
进入自?#20918;?#25252;模式。

优选的,还包括:

第三控制单元,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第三
控制信号,并将所述第三控制信号输出?#20102;?#36848;NVM控制器,所述第三控制信号用于控制所述
NVM控制器禁止读取所述NVM内的数据。

优选的,所述预烧区域为与NVM供电电源的偏移量超过第一偏移量的存储空间。

优选的,所述预烧区域存储的目标预烧值为与初始值相反的值。

优选的,所述预烧区域为1个或多个。

一种集成电路,包括:NVM控制器、以及上述所述的低电压检测逻辑电路;

所述NVM控制器的第一输入端与所述低电压检测逻辑电路的第一信号控制端连
接,所述NVM控制器的第二输入端与NVM连接,所述NVM控制器用于在所述低电压检测逻辑电
路判定从所述NVM预先设置的预烧区域读取的预烧区域返回值等于目标预烧值时,根据所
述低电压检测逻辑电路生成的第一控制信号,从所述NVM内读取数据;在所述低电压检测逻
辑电路判定所述预烧区域返回值不等于所述目标预烧值时,接收所述低电压检测逻辑电路
生成的第三控制信号,所述第三控制信号用于控制所述NVM控制器禁止读取所述NVM内的数
据;

其中,所述目标预烧值为预先烧写到所述预烧区域的值,所述预烧区域为所述NVM
内对低供电电压敏感的存储空间。

优选的,还包括:芯片保护部件;

所述芯片保护部件的输入端与所述低电压检测逻辑电路的第二信号控制端连接,
所述芯片保护部件用于在所述低电压检测逻辑电路判定所述预烧区域返回值不等于所述
目标预烧值时,根据所述低电压检测逻辑电路生成的第二控制信号,触发芯片进入自?#20918;?br />护模式。

一种芯片,包括:上述所述的集成电路。

一种芯片,包括:上述所述的集成电路,以及与所述集成电路连接的NVM,其中,所
述NVM预先设置有对低供电电压敏感的预烧区域,所述预烧区域内预先烧?#20174;?#30446;标预烧值。

从上述的技术方案可知,本发明公开了一种数据读取方法、集成电路及芯片,集成
电路包括:低电压检测逻辑电路和NVM控制器,在NVM控制器从NVM读取数据之前,低电压检
测逻辑电路会首先从NVM的预烧区域读取预烧区域返回值,通过比较预烧区域返回值和预
先烧写到预烧区域的目标预烧值是否相等,确定NVM的供电电压是否正常,并且只有在预烧
区域返回值和目标预烧值相等时,即NVM的供电电压正常时,NVM控制器才会从NVM内读取数
据。由此可知,本发明是在确定NVM的供电电压正常后,才读取NVM内的数据,因此,能够有效
保证读取NVM的数据的稳定性,避免因NVM的供电电压处于非正常状态所带来的读取数据不
稳定的问题。

附图说明

为了更清楚地说明本发明实施例或现有技术中的技术方案,下面将对实施例或现
有技术描述中所需要使用的附图作简单地介绍,显而易见地,下面描述中的附图仅仅是本
发明的实施例,对于本领域普通技术人员来讲,在不付出创造性劳动的前提下,还可以根据
公开的附图获得其他的附图。

图1为本发明实施例公开的一种数据读取方法的方法流程图;

图2为本发明实施例公开的一种NVM中预烧区域界定示意图;

图3为本发明实施例公开的另一种数据读取方法的方法流程图;

图4为本发明实施例公开的另一种数据读取方法的方法流程图;

图5为本发明实施例公开的一种低电压检测逻辑电路的结构示意图;

图6为本发明实施例公开的另一种低电压检测逻辑电路的结构示意图;

图7为本发明实施例公开的一种集成电路的电路图。

具体实施方式

下面将结合本发明实施例中的附图,对本发明实施例中的技术方?#38468;?#34892;清楚、完
整地描述,显然,所描述的实施例仅仅是本发明一部分实施例,而不是全部的实施例。基于
本发明中的实施例,本领域普通技术人员在没有做出创造性劳动前提?#28388;?#33719;得的所有其他
实施例,都属于本发明保护的范围。

本发明实施例公开了一种数据读取方法、集成电路及芯片,以实现对NVM内数据读
取的稳定性,避免因NVM处于非正常供电电压带来的读取数据不稳定的问题。

参见图1,本发明实施例公开的一种数据读取方法的方法流程图,该方法应用于低
电压检测逻辑电路,所述方法包括步骤:

步骤S101、当接收到读取NVM内数据请求时,从所述NVM预先设置的预烧区域读取
预烧区域返回值;

其中,所述预烧区域为所述NVM内对低供电电压敏感的存储空间。

具体的,NVM(NonVolatile Memory,?#19988;资?#23384;储器)是一种具有?#19988;资А?#25353;?#32440;?#23384;
取、存储密度高、低能耗、读写性能接近DRAM的存储器,本实施例中,将NVM存储单元中对低
供电电压最为敏感的存储空间作为预烧区域。根据NVM的存储特性可知,NVM存储单元中不
同的地址空间对于供电电压的敏感程度有所区别,本专利的申请人经过?#33455;?#21457;现,距离NVM
的供电电源比较远的存储单元相比距离NVM的供电电源近的存储单元,更容易在低电压供
电的情况下出现数据读取出错的情况,因此,在实际应用中,可以将与NVM供电电源的偏移
量超过第一偏移量的存储空间作为预烧区域。如图2所示,斜线部分所示的阵列块2即为预
烧区域,而空白区域所示的阵列块1表示的普通数据存储区域则用于存储数据,当需要对
NVM内的数据进行操作时,可通过NVM接口以及操作控制逻辑实现对数据的处理。

需要说明的是,预烧区域不局限于一个,在不影响NVM性能的情况下,可以在NVM内
选取多个低电压敏感区域作为预烧区域,每个预烧区域均为与NVM供电电源的偏移量超过
第一偏移量的存储空间,第一偏移量的数值具体依据实际需要而定。

其中,在实际应用中,也可以根据NVM的研发人?#27604;?#23450;该NVM的预烧区域。

为方便理解,本发明还公开了几种低电压检测逻辑电?#26041;?#25910;读取NVM内数据请求
的应用场景,也即触发低电压检测逻辑电路检测NVM的供电电压的应用场景,包括:

(1)在芯片启动过程中,当芯片中的电路?#20302;?#38656;要从NVM中读取?#20302;?#37197;置信息以完
成?#20302;?#30340;配置时,会触发低电压检测逻辑电路检测NVM的供电电压;

(2)当芯片完成启动后,电路?#20302;?#30001;于应用需求需要触发NVM控制器从NVM中读取
敏感信息时,会触发低电压检测逻辑电路检测NVM的供电电压;

(3)假设芯片?#20889;?#22312;加解密模块,而所有的密钥存储于NVM中时,当需要从NVM中读
取密钥时,会触发低电压检测逻辑电路11检测NVM的供电电压。

步骤S102、判断所述预烧区域返回值是否等于目标预烧值,如果是,则执行步骤
S103;

具体的,目标预烧值为预先烧写到NVM的预烧区域的值,而预烧区域返回值为从
NVM的预烧区域读取的值,当NVM的供电电压正常时,NVM处于稳定状态,在这种情况下,从
NVM的预烧区域读取的预烧区域返回值与预先烧写到预烧区域的目标烧写值相等;反之,当
NVM的供电电压为非正常供电电压(即NVM11的供电电压低于最低电压阈值)时,NVM处于不
稳定状态,在这种情况下,从NVM的预烧区域读取的预烧区域返回值会与预先烧写到预烧区
域的目标烧写值不相?#21462;?br />

其中,目标预烧值的设定依据为:目标预烧值的选取基于NVM内存储单元的结?#22266;?br />性,如果存储单元的结?#22266;?#24615;决定了NVM在低供电电压条件下,无论存储值高还是低,都会
被误认为时初始值,因此,目标预烧值的设定可选用与初始值相反的值,例如,假设默认的
初始值为1‘b0,则目标预烧值可以设定为1’b1;假设默认的初始值为1‘b1,则目标预烧值可
以设定为1’b0。

步骤S103、生成第一控制信号,并将所述第一控制信号输出至NVM控制器,控制所
述NVM控制器从所述NVM内读取数据。

其中,预烧区域返回值相比目标烧写值而言,只要出现比特错误,则判定预烧区域
返回值不等于目标预烧值。

目标预烧值的?#32440;?#24635;数包括但不局限于4*N(N≥1)个,在满足?#20302;?#24615;能的前提下,
可以选取1~4*N(N≥1)中的?#25105;?#20010;数。

综上可知,本发明公开的数据读取方法,在NVM控制器从NVM读取数据之前,低电压
检测逻辑电路会首先从NVM的预烧区域读取预烧区域返回值,通过比较预烧区域返回值和
预先烧写到预烧区域的目标预烧值是否相等,确定NVM的供电电压是否正常,并且只有在预
烧区域返回值和目标预烧值相等时,即NVM的供电电压正常时,NVM控制器才会从NVM内读取
数据。由此可知,本发明是在确定NVM的供电电压正常后,才读取NVM内的数据,因此,能够有
效保证读取NVM的数据的稳定性,避免因NVM的供电电压处于非正常状态所带来的读取数据
不稳定的问题。

为抵御黑客针对NVM处于非稳定状态时的攻击,避免黑客绕开?#20302;?#25511;制对芯片实
施攻击,当低电压检测逻辑电路判定读取的预烧区域返回值不等于目标预烧值时,低电压
检测逻辑电路控制所述芯片保护部件触发芯片进入自?#20918;?#25252;模式。

因此,为进一步优化上述实施例,如图3所示,本发明一实施例公开的另一种数据
读取方法的方法流程图,在图1所示实施例的基础上,还包括步骤:

步骤S104、当所述预烧区域返回值不等于所述目标预烧值时,生成第二控制信号,
并将所述第二控制信号输出至芯片保护部件,控制所述芯片保护部件触发芯片进入自?#20918;?br />护模式。

从上述论述可知,当芯片保护部件触发芯片进入自?#20918;?#25252;模式后,芯片能够抵御
黑客针对NVM处于非稳定状态时的攻击,而芯片的自?#20918;?#25252;模式在触发SoC复位或是不触发
SoC复位的情况下均能实现,因此,上述实施例中,步骤S104控制所述芯片保护部件触发芯
片进入自?#20918;?#25252;模式的过程,具体可以包括:

控制所述芯片保护部件触发SoC(System on Chip,?#20302;?#32423;芯片)复位;或,

在不触发所述SoC复位的情况下,控制所述芯片进入安全模式,以使外部仅能侦测
到NVM低电压的错误信息。

为抵御黑客针对NVM处于非稳定状态时的攻击,避免黑客绕开?#20302;?#25511;制对芯片实
施攻击,当低电压检测逻辑电路判定读取的预烧区域返回值不等于目标预烧值时,还需控
制所述NVM控制器禁止读取所述NVM内数据的操作。

因此,为进一步优化上述实施例,如图4所示,本发明一实施例公开的另一种数据
读取方法的方法流程图,在图1所示实施例的基础上,还包括步骤:

步骤S105、当所述预烧区域返回值不等于所述目标预烧值时,生成第三控制信号,
并将所述第三控制信号输出?#20102;?#36848;NVM控制器,所述第三控制信号用于控制所述NVM控制器
禁止读取所述NVM内的数据。

需要说明的是,在实际应用中,为抵御黑客针对NVM处于非稳定状态时的攻击,避
免黑客绕开?#20302;?#25511;制对芯片实施攻击,当低电压检测逻辑电路判定读取的预烧区域返回值
不等于目标预烧值时,在控制所述芯片保护部件触发芯片进入自?#20918;?#25252;模式的同时,还可
以控制所述NVM控制器禁止读取所述NVM内的数据的操作。

综上可知,本发明公开的数据读取方法,在NVM控制器从NVM读取敏感数据之前,低
电压检测逻辑电路会首先从NVM的预烧区域读取预烧区域返回值,通过比较预烧区域返回
值和预先烧写到预烧区域的目标预烧值是否相等,确定NVM的供电电压是否正常,并且只有
在预烧区域返回值和目标预烧值相等时,即NVM的供电电压正常时,NVM控制器才会从NVM内
读取敏感数据,反之,芯片保护部件会触发芯片进入自?#20918;?#25252;模式,同时NVM控制器读取NVM
内敏感数据的操作也会被禁止。由此可知,本发明是在确定NVM的供电电压正常后,才读取
NVM内的敏感数据,因此,能够有效保证读取NVM的敏感数据的稳定性,避免因NVM的供电电
压处于非正常状态所带来的读取数据不稳定的问题。

与上述方法实施例相对应,本发明还公开了一种低电压检测逻辑电路。

参见图5,本发明实施例公开的一种低电压检测逻辑电路的结构示意图,低电压检
测逻辑电路11分别与NVM10、NVM控制器12连接,低电压检测逻辑电路11包括:

读取单元111,用于当接收到读取NVM10内数据请求时,从所述NVM10预先设置的预
烧区域读取预烧区域返回值;

其中,所述预烧区域为所述NVM10内对低供电电压敏感的存储空间,根据NVM的存
储特性可知,NVM存储单元中不同的地址空间对于供电电压的敏感程度有所区别,本专利的
申请人经过?#33455;?#21457;现,距离NVM的供电电源比较远的存储单元相比距离NVM的供电电源近的
存储单元,更容易在低电压供电的情况下出现数据读取出错的情况,因此,在实际应用中,
可以将与NVM供电电源的偏移量超过第一偏移量的存储空间作为预烧区域。

需要说明的是,预烧区域不局限于一个,在不影响NVM性能的情况下,可以在NVM内
选取多个低电压敏感区域作为预烧区域,每个预烧区域均为与NVM供电电源的偏移量超过
第一偏移量的存储空间,第一偏移量具体数值依据实际需要而定。

其中,在实际应用中,也可以根据NVM的研发人?#27604;?#23450;该NVM的预烧区域。

第一控制单元112,用于当所述预烧区域返回值等于目标预烧值时,生成第一控制
信号,并将所述第一控制信号输出至NVM控制器12,控制所述NVM控制器12从所述NVM10内读
取数据。

其中,NVM控制器12是一种位于芯片内部,用于读取NVM10数据的部件。

目标预烧值的设定依据为:目标预烧值的选取基于NVM内存储单元的结?#22266;?#24615;,如
果存储单元的结?#22266;?#24615;决定了NVM在低供电电压条件下,无论存储值高还是低,都会被误认
为时初始值,因此,目标预烧值的设定可选用与初始值相反的值,例如,假设默认的初始值
为1‘b0,则目标预烧值可以设定为1’b1;假设默认的初始值为1‘b1,则目标预烧值可以设定
为1’b0。

综上可知,本发明公开的低电压检测逻辑电路11,在NVM控制器12从NVM10读取数
据之前,低电压检测逻辑电路11会首先从NVM10的预烧区域读取预烧区域返回值,通过比较
预烧区域返回值和预先烧写到预烧区域的目标预烧值是否相等,确定NVM10的供电电压是
否正常,并且只有在预烧区域返回值和目标预烧值相等时,即NVM10的供电电压正常时,NVM
控制器12才会从NVM10内读取数据。由此可知,本发明是在确定NVM10的供电电压正常后,才
读取NVM10内的数据,因此,能够有效保证读取NVM10的数据的稳定性,避免因NVM10的供电
电压处于非正常状态所带来的读取数据不稳定的问题。

为进一步优化上述实施例,参见图6,本发明另一实施例公开的一种低电压检测逻
辑电路的结构示意图,在图5所示实施例的基础上,低电压检测逻辑电路还可以包括:

第二控制单元113,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第
二控制信号,并将所述第二控制信号输出至芯片保护部件13,控制所述芯片保护部件13触
发芯片进入自?#20918;?#25252;模式。

从上述论述可知,当芯片保护部件13触发芯片进入自?#20918;?#25252;模式后,芯片能够抵
御黑客针对NVM处于非稳定状态时的攻击,而芯片的自?#20918;?#25252;模式在触发SoC复位或是不触
发SoC复位的情况下均能实现,因此,上述实施例中,第二控制单元53控制所述芯片保护部
件13触发芯片进入自?#20918;?#25252;模式的过程,具体可以包括:

控制所述芯片保护部件13触发SoC(System on Chip,?#20302;?#32423;芯片)复位;或,

在不触发所述SoC复位的情况下,控制所述芯片进入安全模式,以使外部仅能侦测
到NVM低电压的错误信息。

为抵御黑客针对NVM处于非稳定状态时的攻击,避免黑客绕开?#20302;?#25511;制对芯片实
施攻击,当低电压检测逻辑电路11判定读取的预烧区域返回值不等于目标预烧值时,还需
控制所述NVM控制器12禁止读取所述NVM10内的数据的操作。

因此,低电压检测逻辑电路还可以包括:

第三控制单元114,用于当所述预烧区域返回值不等于所述目标预烧值时,生成第
三控制信号,并将所述第三控制信号输出?#20102;?#36848;NVM控制器12,所?#38236;?#19977;控制信号用于控制
所述NVM控制器12禁止读取所述NVM10内的数据。

需要说明的是,在实际应用中,为抵御黑客针对NVM处于非稳定状态时的攻击,避
免黑客绕开?#20302;?#25511;制对芯片实施攻击,当低电压检测逻辑电路判定读取的预烧区域返回值
不等于目标预烧值时,可以同时控制第二控制单元113控制所述芯片保护部件触发芯片进
入自?#20918;?#25252;模式,以及第三控制单元114控制所述NVM控制器12禁止读取所述NVM10内的数
据。

综上可知,本发明公开的低电压检测逻辑电路11,在NVM控制器12从NVM10读取数
据之前,低电压检测逻辑电路11会首先从NVM10的预烧区域读取预烧区域返回值,通过比较
预烧区域返回值和预先烧写到预烧区域的目标预烧值是否相等,确定NVM10的供电电压是
否正常,并且只有在预烧区域返回值和目标预烧值相等时,即NVM10的供电电压正常时,NVM
控制器12才会从NVM10内读取数据,反之,芯片保护部件13会触发芯片进入自?#20918;?#25252;模式,
同时控制NVM控制器12禁止读取NVM10内的数据。由此可知,本发明是在确定NVM10的供电电
压正常后,才读取NVM10内的数据,因此,能够有效保证读取NVM10的数据的稳定性,避免因
NVM10的供电电压处于非正常状态所带来的读取数据不稳定的问题。

为方便理解,本发明还公开了几种低电压检测逻辑电路11接收读取NVM10内数据
请求的应用场景,也即触发低电压检测逻辑电路11检测NVM10的供电电压的应用场景,包
括:

(1)在芯片启动过程中,当芯片中的电路?#20302;?#38656;要从NVM10中读取?#20302;?#37197;置信息以
完成?#20302;?#30340;配置时,会触发低电压检测逻辑电路11检测NVM10的供电电压;

(2)当芯片完成启动后,电路?#20302;?#30001;于应用需求需要触发NVM控制器12从NVM10中
读取敏感信息时,会触发低电压检测逻辑电路11检测NVM10的供电电压;

(3)假设芯片?#20889;?#22312;加解密模块,而所有的密钥存储于NVM10中时,当需要从NVM10
中读取密钥时,会触发低电压检测逻辑电路11检测NVM10的供电电压。

当低电压检测逻辑电路11在上述三个情形下触发后,首先电路?#20302;?#36827;入从NVM10
中读取?#20302;?#37197;置信息、密钥或其他敏感信息的预备状态;然后低电压检测逻辑电路11从预
烧区域读取预烧区域返回值,判断预烧区域返回值是否等于目标预烧值;若所述预烧区域
返回值等于所述目标预烧值,则生成第一控制信号,并将所述第一控制信号输出至NVM控制
器12,控制所述NVM控制器12从所述NVM内读取?#20302;?#37197;置信息、密钥或其他敏感信息;若所述
预烧区域返回值不等于所述目标预烧值,则生成第二控制信号和第三控制信号,并将所述
第二控制信号输出至芯片保护部件13,控制所述芯片保护部件13触发芯片进入自?#20918;?#25252;模
式,将所述第三控制信号输出?#20102;?#36848;NVM控制器12,所述第三控制信号用于控制所述NVM控
制器12禁止读取所述NVM内的?#20302;?#37197;置信息、密钥或其他敏感信息。

参见图7,本发明还公开了一种集成电路的电路图,该集成电路包括:NVM控制器12
以及上述的低电压检测逻辑电路11;

所述NVM控制器12的第一输入端与所述低电压检测逻辑电路11的第一信号控制端
连接,所述NVM控制器12的第二输入端与NVM10连接,所述NVM控制器12用于在所述低电压检
测逻辑电路11判定从所述NVM10预先设置的预烧区域读取的预烧区域返回值等于目标预烧
值时,根据所述低电压检测逻辑电路生成的第一控制信号,从所述NVM10内读取数据;在所
述低电压检测逻辑电路11判定所述预烧区域返回值不等于所述目标预烧值时,接收所述低
电压检测逻辑电路11生成的第三控制信号,所述第三控制信号用于控制所述NVM控制器12
禁止读取所述NVM10内的数据;

其中,所述目标预烧值为预先烧写到所述预烧区域的值,所述预烧区域为所述
NVM10内对低供电电压敏感的存储空间。

需要说明的是,低电压检测逻辑电路11的具体工作原理,请参见上述实施例,此次
不再赘述。

为抵御黑客针对NVM处于非稳定状态时的攻击,避免黑客绕开?#20302;?#25511;制对芯片实
施攻击,当低电压检测逻辑电路11判定读取的预烧区域返回值不等于目标预烧值时,还可
以控制芯片保护部件13触发芯片进入自?#20918;?#25252;模式。

因此,为进一步优化上述实施例,在上述实施例的基础上,集成电路还可以包括:
芯片保护部件13;

所述芯片保护部件13的输入端与所述低电压检测逻辑电路11的第二信号控制端
连接,所述芯片保护部件13用于在所述低电压检测逻辑电路11判定所述预烧区域返回值不
等于所述目标预烧值时,根据所述低电压检测逻辑电路11生成的第二控制信号,触发芯片
进入自?#20918;?#25252;模式。

从上述论述可知,当芯片保护部件13触发芯片进入自?#20918;?#25252;模式后,芯片能够抵
御黑客针对NVM处于非稳定状态时的攻击,而芯片的自?#20918;?#25252;模式在触发SoC复位或是不触
发SoC复位的情况下均能实现,因此,当低电压检测逻辑电路11控制所述芯片保护部件13触
发芯片进入自?#20918;?#25252;模式的过程,具体可以包括:

控制所述芯片保护部件13触发SoC(System on Chip,?#20302;?#32423;芯片)复位;或,

在不触发所述SoC复位的情况下,控制所述芯片进入安全模式,以使外部仅能侦测
到NVM低电压的错误信息。

综上可知,本发明公开的集成电路,在NVM控制器12从NVM10读取数据之前,低电压
检测逻辑电路11会首先从NVM10的预烧区域读取预烧区域返回值,通过比较预烧区域返回
值和预先烧写到预烧区域的目标预烧值是否相等,确定NVM10的供电电压是否正常,并且只
有在预烧区域返回值和目标预烧值相等时,即NVM10的供电电压正常时,NVM控制器12才会
从NVM10内读取数据,反之,芯片保护部件13会触发芯片进入自?#20918;?#25252;模式,同时控制NVM控
制器12禁止读取NVM10内的数据。由此可知,本发明是在确定NVM10的供电电压正常后,才读
取NVM10内的数据,因此,能够有效保证读取NVM10的数据的稳定性,避免因NVM10的供电电
压处于非正常状态所带来的读取数据不稳定的问题。

本领域技术人员可以理解的是,芯片是由集成电路构成的,而NVM10既可以位于芯
片外部,也可以位于芯片内部,因此,在上述实施例的基础上,本发明?#22266;?#20379;了两种芯片,第
一种芯片集成有上述实施例中的集成电路,但并没有集成NVM10;第二种芯片同时集成有上
述实施例中的集成电路和NVM10,其中,NVM10与集成电路连接,NVM10预先设置有对低供电
电压敏感的预烧区域,所述预烧区域内预先烧?#20174;?#30446;标预烧值。

需要说明的是,在芯片量产阶段或者使测试阶段,通过NVM专有测试口将目标预烧
值成功烧入到NVM10的预烧区域后,还需对该预烧区域加以写保护,避免NVM10在正常的功
能模?#36739;攏?#22240;CPU(Central Processing Unit,中央处理器)的错误烧写改写预烧区域的目
标预烧值。

为方便理解,本发明?#22266;?#20379;了几种触发低电压检测逻辑电路11检测NVM10的供电
电压的应用场景,包括:

(1)在芯片启动过程中,当芯片中的电路?#20302;?#38656;要从NVM10中读取?#20302;?#37197;置信息以
完成?#20302;?#30340;配置时,会触发低电压检测逻辑电路11检测NVM10的供电电压;

(2)当芯片完成启动后,电路?#20302;?#30001;于应用需求需要触发NVM控制器12从NVM10中
读取敏感信息时,会触发低电压检测逻辑电路11检测NVM10的供电电压;

(3)假设芯片?#20889;?#22312;加解密模块,而所有的密钥存储于NVM10中时,当需要从NVM10
中读取密钥时,会触发低电压检测逻辑电路11检测NVM10的供电电压。

当低电压检测逻辑电路11在上述三个情形下触发后,首先电路?#20302;?#36827;入从NVM10
中读取?#20302;?#37197;置信息、密钥或其他敏感信息的预备状态;然后低电压检测逻辑电路11从预
烧区域读取预烧区域返回值,判断预烧区域返回值是否等于目标预烧值;若所述预烧区域
返回值等于所述目标预烧值,则生成第一控制信号,并将所述第一控制信号输出至NVM控制
器,控制所述NVM控制器从所述NVM内读取?#20302;?#37197;置信息、密钥或其他敏感信息;若所述预烧
区域返回值不等于所述目标预烧值,则生成第二控制信号和第三控制信号,并将所述第二
控制信号输出至芯片保护部件13,控制所述芯片保护部件13触发芯片进入自?#20918;?#25252;模式,
将所述第三控制信号输出?#20102;?#36848;NVM控制器12,所述第三控制信号用于控制所述NVM控制器
12禁止读取所述NVM内的?#20302;?#37197;置信息、密钥或其他敏感信息。

最后,还需要说明的是,在本文中,诸如第一和第二等之类的关系术语仅仅用来将
一个实体或者操作与另一个实体或操作区分开来,而不一定要求或者暗示这些实体或操作
之间存在任何这种实际的关系或者顺序。而且,术语“包括”、“包含”或者其任何其他变体意
在涵盖非排他性的包含,从而使得包括一系列要素的过程、方法、物品或者设备不仅包括那
些要素,而?#19968;?#21253;括没有明确列出的其他要素,或者是还包括为这种过程、方法、物品或者
设备所固有的要素。在没有更多限制的情况下,由语句“包括一个……”限定的要素,并不排
除在包括所述要素的过程、方法、物品或者设备中还存在另外的相同要素。

本说明书中各个实施例采用递进的方式描述,每个实施例重点说明的都是与其他
实施例的不同之处,各个实施例之间相同相似部?#21482;?#30456;参见即可。

?#36816;?#20844;开的实施例的上述说明,使本领域专业技术人员能够实?#21482;?#20351;用本发明。
对这些实施例的多种修改对本领域的专业技术人员?#27492;到?#26159;显而易见的,本文中所定义的
一般原理可以在不脱离本发明的精神或范围的情况下,在其它实施例中实现。因此,本发明
将不会被限制于本文所示的这些实施例,而是要符合与本文所公开的原理和新颖特点相一
致的最宽的范围。

关于本文
本文标题:一种数据读取方法、集成电路及芯片.pdf
链接地址:http://www.pqiex.tw/p-6079642.html
关于我们 - 网站声明 - 网?#38236;?#22270; - 资源地图 - 友情链接 - 网站客服 - 联系我们

[email protected] 2017-2018 zhuanlichaxun.net网站版权所有
经营许可证编号:粤ICP备17046363号-1 
 


收起
展开
平码五不中公式规律 北京赛车pk10代理 极速11选5是私彩吗 银河棋牌游戏平台 宁夏11选5任三必中规矩 永利棋牌app 澳洲幸运5全国开奖吗 海南飞鱼彩票推荐 11选5中奖规则 股票型基金 双色球蓝球的黄金分割点